OSDN > 浏览软件 > Scientific/Engineering > Electronic Design Automation/Assistance (EDA) > CSV-Verilog Maker II > 下载文件列表 > 软件包 CSV-Verilog Maker (Old Version) > Release 1.00

CSV-Verilog Maker II

RSS Back to release list
Download List

项目描述

CSV-Verilog Maker IIはＣＳＶプリプロセッサ上で動作するプログラムです。

Excelで検証内容や設計内容を記載し、Verilogに変換するソースコード自動生成プログラムです。

系统要求

System requirement is not defined

评

平均

5.0

3 评分次数

5 星	3
4 星	0
3 星	0
2 星	0
1 星	0

Your rating

Review this project

CSV-CPU Maker II

1.07a

1.06

1.05

1.04

1.02

1.01

1.00

CSV-CPU Maker (Old Version)

1.02

CSV-SystemC Maker II

0.94a

0.95a

CSV-Verilog Maker II

1.28a

1.28

1.27

1.26b

1.26a

1.26

1.25

1.24

1.23

1.22

1.21

1.20d

1.20c

1.20b

1.20a

1.20

1.19a

1.19

1.18

1.17a

1.15

1.14

1.13a

CSV-Verilog Maker (Old Version)

1.00

sample

20090622-1

SystemC Source Maker

1.08

1.07

1.06

1.05

1.04

1.03

1.01

1.00

verilog_model

1.03

1.02

1.01

1.00

Verilog Source Maker

1.01

1.00

发布: 2009-05-17 17:30
CSV-Verilog Maker (Old Version) 1.00 (1 files 隐藏)

发布版本通知

No Release Notes

变更日志

No Changelogs

CSV-Verilog Maker II

RSS Back to release list Download List

项目描述

系统要求

评

Your rating on CSV-Verilog Maker II

发布: 2009-05-17 17:30 CSV-Verilog Maker (Old Version) 1.00 (1 files 隐藏)

发布版本通知

变更日志

RSS Back to release list
Download List

发布: 2009-05-17 17:30
CSV-Verilog Maker (Old Version) 1.00 (1 files 隐藏)